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CPLD內部
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　內部自復位信號是器件上電后僅產生一次的信號，之后一直保持無效至器件掉電。這種一次性信號，產生它的數字電路自身需要一個初始的確定狀態，并且需要上電后就處于該種狀態；對于FPGA來說，其內部寄存器在上電后的狀態是不確定的，即無法預期的，因此利用寄存器的狀態來產生復位信號，不是那么可靠；但我們可以考慮FPGA的其他資源，一般FPGA內部都有RAM資源，這些RAM都可以被配置數據初始化的，也就是說當FPGA上電配置完成后，被初始化的RAM的數據內容是確定的。利用這個特點，我們就可以設計可靠的內部自復位信號。